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Etienne BRATEAU
diglog
Validations
0bd0d94f
Valider
0bd0d94f
rédigé
6 years ago
par
Etienne BRATEAU
Parcourir les fichiers
Options
Téléchargements
Correctifs
Plain Diff
wire: avoir forward declaration of two functions
parent
dff0db0d
Aucune branche associée trouvée
Branches contenant la validation
Aucune étiquette associée trouvée
Étiquettes contenant la validation
Aucune requête de fusion associée trouvée
Pipeline
#1480
réussi
6 years ago
Étape : build
Modifications
1
Pipelines
1
Masquer les modifications d'espaces
En ligne
Côte à côte
Affichage de
1 fichier modifié
src/wire.c
+37
-39
37 ajouts, 39 suppressions
src/wire.c
avec
37 ajouts
et
39 suppressions
src/wire.c
+
37
−
39
Voir le fichier @
0bd0d94f
...
@@ -10,8 +10,43 @@
...
@@ -10,8 +10,43 @@
#include
"log.h"
#include
"log.h"
#include
"screen.h"
#include
"screen.h"
void
fryhwire
(
log_hwrec
*
hw
);
void
fryhwire
(
log_hwrec
*
hw
)
void
fryvwire
(
log_vwrec
*
vw
);
{
long
t0
;
remcursor
();
clipon
();
t0
=
sysclock
();
while
(
labs
(
sysclock
()
-
t0
)
<
frytime
)
{
m_color
((
long
)
gg
.
color
.
conflict
);
hline
(
hw
->
x1
,
hw
->
x2
,
hw
->
y
);
m_color
((
long
)
gg
.
color
.
backgr
);
hline
(
hw
->
x1
,
hw
->
x2
,
hw
->
y
);
}
clipoff
();
refreshsoon
();
}
void
fryvwire
(
log_vwrec
*
vw
)
{
long
t0
;
remcursor
();
clipon
();
t0
=
sysclock
();
while
(
labs
(
sysclock
()
-
t0
)
<
frytime
)
{
m_color
((
long
)
gg
.
color
.
conflict
);
vline
(
vw
->
x
,
vw
->
y1
,
vw
->
y2
);
m_color
((
long
)
gg
.
color
.
backgr
);
vline
(
vw
->
x
,
vw
->
y1
,
vw
->
y2
);
}
clipoff
();
refreshsoon
();
}
/* Local variables for wantsolder: */
/* Local variables for wantsolder: */
struct
LOC_wantsolder
struct
LOC_wantsolder
...
@@ -939,40 +974,3 @@ void addvwire2(short x, short y1, short y2)
...
@@ -939,40 +974,3 @@ void addvwire2(short x, short y1, short y2)
addvwire
(
x
,
y1
,
y2
,
log_wcol_normal
);
addvwire
(
x
,
y1
,
y2
,
log_wcol_normal
);
}
}
void
fryhwire
(
log_hwrec
*
hw
)
{
long
t0
;
remcursor
();
clipon
();
t0
=
sysclock
();
while
(
labs
(
sysclock
()
-
t0
)
<
frytime
)
{
m_color
((
long
)
gg
.
color
.
conflict
);
hline
(
hw
->
x1
,
hw
->
x2
,
hw
->
y
);
m_color
((
long
)
gg
.
color
.
backgr
);
hline
(
hw
->
x1
,
hw
->
x2
,
hw
->
y
);
}
clipoff
();
refreshsoon
();
}
void
fryvwire
(
log_vwrec
*
vw
)
{
long
t0
;
remcursor
();
clipon
();
t0
=
sysclock
();
while
(
labs
(
sysclock
()
-
t0
)
<
frytime
)
{
m_color
((
long
)
gg
.
color
.
conflict
);
vline
(
vw
->
x
,
vw
->
y1
,
vw
->
y2
);
m_color
((
long
)
gg
.
color
.
backgr
);
vline
(
vw
->
x
,
vw
->
y1
,
vw
->
y2
);
}
clipoff
();
refreshsoon
();
}
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